信號源是導彈測試設備的重要組成部分，它能模擬部件發出各種激勵信號以檢查測試部件，同時還能與其他設備儀器模擬整個部件輸出，以檢查地面綜合測試設備是否正常工作[1]。角速度編碼器組合是導彈武器設備的重要組成部件[2]，在完成對它的測試任務時，信號源的設計是其中一個關鍵的部分。信號源模塊能夠產生符合角速度編碼器組合要求的中頻信號、視頻信號和其他波形信號。

    本文基于計算機串行通信總線，在單片機的控制下使用一片FPGA芯片實現了幅度、相位、頻率均可調的任意波形發生器。
1 信號源模塊總體結構
    整個信號源模塊的總體結構如圖1所示。首先通過總控制器選擇信號波形種類，并設定其參數。然后通過計算機串行通信接口將波形參數信息發送給單片機芯片，單片機將這些指令轉化為控制代碼，分別控制D/A轉換器、驅動放大電路，進而產生視頻脈沖；同時控制FPGA，進而實現對DDS的控制，再通過D/A轉換電路、放大電路和低通濾波器LPF產生系統需要的任意波形。

    該信號源是在串行通信總線控制下設計的，整個系統硬件主要由主控制器、單片機、FPGA、DDS、D/A轉換電路、信號放大電路和低通濾波器組成。其主要模塊功能如下：
    (1)總控制器：即主控計算機，測試系統選用的是工控機，其性能較為穩定、堅固，且抗干擾性能好。
    (2)單片機：選擇AT89S51單片機，單片機與總控制器之間通過串行通信總線RS232進行通信。
    (3)FPGA芯片：主要實現與單片機之間的通信以及對DDS的邏輯控制，它是信號源模塊的核心。本系統中FPGA選用的是Altera公司Cyclone Ⅱ系列的EP2C8Q208，它具有豐富的接口和內部邏輯資源，滿足系統設計的要求。
    (4)DDS芯片：選用一款性能優異的DDS芯片AD9959，它主要有以下幾個特點：4路同步輸出通道，各通道具有獨立的頻率、相位、幅度控制功能；超強的通道之間隔離度（＞65 dB）；16級的頻率、相位、幅度調制能力；可通過硬件、軟件控制節電模式。
    (5)DDS模塊：根據角速度編碼器組合測試系統的需求，設計了一個采用改進型DDS結構的正交信號發生器，用來輸出一組完全正交的信號，便于進行正交調制。
    (6)A/D轉換器：選用一款單芯片、12 bit、40 MS/s A/D轉換器AD9224，它采用單電源（+5 V）供電，內置一個片內高性能采樣放大器和基準電壓源。
    此外，為了得到高質量的信號，一般采用低通濾波器濾除信號中附加的一些雜散和諧波成分。
2 信號源模塊設計與實現
2.1 DDS的FPGA實現
2.1.1 DDS模塊設計
    根據本系統所產生激勵信號的要求，設計了一個正交信號發生器，即能同時產生正弦和余弦輸出的信號發生器，其兩路輸出是正交的，且具有很好的可移植性。所設計的DDS模塊如圖2所示。

   

    (4)相位控制字：用于改變輸出信號的相位參數（相移）。相位累加器后的加法器為相位調制器，相位字輸入(含同步寄存器)可以改用偽隨機序列信號發生器，以減小由于數據位的截斷而造成的相位失真。如果是單路信號，去掉一路ROM和DAC即可，因此具有很好的通用性。
    (5)幅度控制字：用于改變輸出信號的幅度。幅度控制字的值即為輸出信號幅度的衰減倍數。
    (6)頻率輸入字：用來控制輸出信號的頻率大小，相位輸入字用于調節輸出信號的相位參數，而輸出信號幅度可以通過在ROM查找表之后、DAC之前放置一個乘法器模塊進行調節。
2.1.2 FPGA的內部邏輯電路設計與仿真驗證
    基于Altera公司的QuartusII 7.2軟件環境，使用VHDL對DDS的FPGA實現進行設計。圖3是FPGA實現DDS模塊的頂層結構圖，整個DDS模塊主要由鎖相環(PLL)、相位累加器、相位調制器、衰減器和ROM這幾個小模塊組成。圖4是FPGA控制DDS模塊產生正、余弦波的仿真結果。其中，clk是系統的時鐘，fword是頻率控制字，pword是12 bit相位輸入字，fword是32 bit頻率輸入字，address是ROM的地址。ROM的輸入地址為12 bit，輸出的數據也為12 bit，輸出的數據是信號源波形的幅度參數。

    通過QuartusII 7.2軟件對FPGA內部邏輯電路進行仿真驗證，并將輸出波形用模擬形式表示出來，仿真結果如圖4所示。其中，pword是相位控制字；pout是沒有經過相位調制器（即頂層結構中adder12b和reg12b子模塊），直接將相位累加器輸出數據（32 bit）的高12位dout[31..20]作為ROM的地址，從而得出來的正弦波形；fout是輸出的正弦波形，fout1是輸出的余弦波形，fout與fout1是一組正交信號。頻率控制字用來控制輸出波形的頻率，相位控制字用來控制輸出波形的初始相位。
    為了滿足被測組合實際輸入信號的要求，系統在圖3所示電路的基礎上設計了一個用于控制頻率控制字、相位控制字和幅度控制字大小變化的模塊。此外，系統還會對輸出信號頻率、相位和幅度進行檢測，如果頻率值或幅度值高于或者低于預定的值，則需要總控制器對其進行處理。
    在QuartusII 7.2軟件中對DDS模塊頂層結構中的ROM數據進行更新，分別儲存三角波和鋸齒波等波形參數數據，就可以實現FPGA控制DDS模塊任意波形。
2.2 FPGA控制AD9959實現波形輸出
    角速度編碼器組合是導彈彈上設備的重要組成部分，其狀態直接影響到導彈的性能，針對它的測試系統設計必須保證高度的可靠性，以確保沒有意外情況發生。因此，本系統設計中使用FPGA控制AD9959芯片產生4路信號當作備用的信號源。AD9959采用SPI串行接口與FPGA進行通信。按照AD9959芯片的工作時序圖給SPI口依次寫入控制字，然后輸出的信號再通過信號調理電路（主要是信號放大電路和低通濾波器）便可以產生所需要的4路頻率信號波形。
2.3 視頻脈沖的產生
    視頻脈沖信號是本系統的開關信號。隨著計算機技術的發展及模/數轉換產品性能的不斷提升，實現高精度可控的視頻脈沖信號變得十分容易。系統產生視頻脈沖信號的原理如圖1所示。具體工作過程是：單片機通過串行通信接口接收總控制器的控制指令，然后將其轉化為控制代碼，再經過12 bit D/A轉換器AD9224轉化為數字信號，此信號經過驅動放大電路放大后便可以得到所需要的視頻脈沖信號。
2.4 DAC電路及信號調理電路設計
    D/A轉換器的作用是把合成的信號波形數字量轉化成模擬量。D/A轉換器的分辨率越高，輸出波形的精度越高。隨著量化精度的增加，頻譜中雜波的幅度也就相應降低[3]。本系統使用12 bit分辨率的高精度D/A芯片AD9752和集成運放芯片LM6261實現DAC電路及信號調理電路的設計，通過改變信號調理電路中電位器的大小即可調整輸出電壓的峰峰值。
2.5 FPGA與單片機之間的通信
    FPGA與單片機之間的通信方式一般有總線方式與獨立方式兩種。AT89C51單片機具有很強的外部總線擴展能力，利用片外控制、數據和地址三總線結構能夠很容易地實現單片機與FPGA之間的總線接口設計。而且，單片機與FPGA之間以總線方式進行通信有如下優點：節省FPGA芯片的I/O口；單片機編程簡捷，控制可靠；在FPGA中通過邏輯切換，單片機易于與SRAM或ROM接口[4]。此外，單片機與FPGA以總線方式進行數據通信時，其通信工作時序是純硬件行為，速度要比獨立方式快得多。因此，本系統采用總線方式實現單片機與FPGA之間的通信。

    本設計在單片機的控制下，基于FPGA和DDS模塊實現了任意波形的產生，且輸出信號的頻率、幅度、相位均可通過總控制器軟件由用戶進行調整。當輸出波形需要改變時，只需改變存儲波形參數的ROM數據，就可以靈活地控制任意波形的輸出。通過仿真驗證了信號源的可實現性，本信號源的輸出信號頻率穩定性高，相位和幅度連續可調，頻率轉換速度快，符合導彈角速度編碼器組合測試系統的設計要求，具有很好的應用價值。
參考文獻
[1] 仇召輝，岳瑞華.導彈自動化測試系統標準信號源研究與設計[J].彈箭與制導學報，2008，28(2)：242-244.
[2] GUTTERMAN L.PXI for military test applications[C].IEEE AUTOTESTCON Proceedings，2002：215-226.
[3] 趙呈愷.通用測試臺模擬信號源的設計[D].太原：中北大學，2009.
[4] 游志宇，張洪，董秀成，等.MCS_51與FPGA_CPLD總線接口邏輯設計[J].單片機與嵌入式系統應用，2008(1)：29-32.