目前，模數轉換器(ADC" title="ADC">ADC)已經應用于大量設備。很早以前，轉換器是需要專門知識才能設計和制造的器件，因此采用轉換器的解決方案成本很高。12位/500kHz的ADC在1975年賣到270美元。隨著時間的推移，采用與數字集成電路" title="集成電路">集成電路相同工藝技術的現代轉換器的價格急劇下降。今天同樣的12位/500kHz轉換器價格還不到1美元。ADC經常用于通信、儀器和測量以及計算機系統中，可方便數字信號處理和/或信息的存儲。很多時候ADC功能與數字電路集成在同一芯片" title="芯片">芯片上，但有的設備要求必須使用獨立的ADC。蜂窩電話是數字芯片中集成ADC功能的一個例子，而具有更高要求的蜂窩基站需要依賴單獨的ADC來提供最佳性能。
ADC有以下一些特點：1. 模擬輸入，可以是單通道或多通道模擬輸入；2. 參考輸入電壓，該電壓可以由外部提供，也可以在ADC內部產生；3. 時鐘輸入，通常由外部提供，用于確定ADC的轉換速率；4. 電源輸入，通常有模擬和數字電源引腳；5. 數字輸出，ADC可以提供并行或串行的數字輸出。圖給出了典型的ADC功能框圖。
雖然ADC看起來非常簡單，但它們必須正確使用才能獲得最優的性能。ADC具有與簡單模擬放大器相同的性能限制，比如有限增益、偏置電壓、共模輸入電壓限制和諧波失真等。ADC的采樣特性需要我們更多地考慮時鐘抖動和混疊。以下一些指南有助于工程師在設計中充分發揮ADC的全部性能。
模擬輸入
要認真對待ADC的模擬輸入信號，盡量使它保持干凈，“無用輸入”通常會導致“數字化的無用輸出”。模擬信號路徑應遠離任何快速開關的數字信號線，以防止噪聲從這些數字信號線耦合進模擬路徑。
雖然簡化框圖給出的是單端模擬輸入，但在高性能ADC上經常使用差分模擬輸入。差分驅動ADC可以提供更強的共模噪聲抑制性能，由于有更小的片上信號擺幅，因此一般也能獲得更好的交流性能。差分驅動一般使用差分放大器或變壓器實現。變壓器可以提供比放大器更好的性能，因為有源放大器會帶來影響總體性能的額外噪聲源。但是，如果需要處理的信號含有直流成份，具有隔直流特性的變壓器就不能用。在設計預驅動電路時必須考慮驅動放大器的噪聲和線性性能。需要注意的是，因為高性能ADC通常有非常高的輸入帶寬，因此在ADC輸入引腳處直接濾波可以減少混入基帶的寬帶噪聲數量。
參考輸入
參考輸入應看作是另一個模擬輸入，必須盡可能保持干凈。參考電壓(VREF)上的任何噪聲與模擬信號上的噪聲是沒有區別的。一般ADC的數據手冊上會規定要求的去耦電容。這些電容應放置在離ADC最近的地方。為了節省電路板面積，PCB設計師有時會將去耦電容放在PCB的背面，這種情況應盡可能避免，因為過孔的電感會降低高頻時電容的去耦性能。VREF通常用來設置ADC的滿刻度范圍，因此減小VREF電壓值會減小ADC的LSB值，使得ADC對系統噪聲更加敏感(1V滿刻度10位ADC的LSB值等于1V/210=1mV)。
圖1：典型的模數轉換器功能框圖
時鐘輸入
根據具體的應用，數字時鐘輸入可能與模擬輸入具有同等的重要性。ADC中有兩大噪聲源：一個是由輸入信號的量化引起的(正比于ADC中的位數)，另一個是由時鐘抖動引起的(在錯誤時間點采樣輸入信號)。根據以下公式，在非過采樣ADC應用中量化噪聲將限制最大可能的信噪比(SNR)值。
其中，N為ADC的位數、SNR為信噪比。
從直觀感覺這是有意義的：每增加一位，ADC編碼的總數量就會增加一倍，量化不確定性可降低一半(6dB)。因此理論上一個10位ADC可以提供61.96dB的SNR。根據以下等式，采樣時鐘上的任何抖動都會進一步降低SNR：
其中，SNRj是受抖動限制的SNR，fa是模擬輸入頻率，tj是時鐘抖動的均方根(rms)值。
用抖動等于8ps的采樣時鐘數字化70MHz的模擬信號，可以得到接近49dB SNR的有限抖動，相當于將10位ADC的性能降低到了約8位。時鐘抖動必須小于2ps才能取得等效于10位ADC的SNR。還有許多影響SNR的二階因素，但上述等式是非常好的一階接近函數。差分時鐘常用來減小抖動。
電源輸入
大多數ADC有分離的電源輸入，一個用于模擬電路，一個用于數字電路。推薦在盡量靠近ADC的位置使用足夠多的去耦電容。盡量減少PCB的過孔數量，并減小從ADC電源引腳到去耦電容的走線長度，從而使ADC和電容之間的電感為最小。就像參考電壓去耦一樣，電路板設計師為了節省電路板面積有時會把去耦電容放在芯片下方PCB板的背面，基于同樣的理由，這種情況也應避免。ADC數據手冊一般會提供推薦的去耦方案。為了達到特定的性能，電源和地經常會采用專門的PCB層實現。
數字輸出
ADC開關數字信號輸出會產生瞬時噪聲，并向后耦合到ADC中敏感的模擬電路部分，從而引發故障?？s短輸出走線長度以減小ADC驅動的電容負載有助于減小這一影響，在ADC輸出端放置串行電阻也可以降低輸出電流尖峰。ADC數據手冊通常對此也有一些設計建議。
