摘? 要: 分析了嵌入式系統開發中常用的三種芯片編程方法，介紹了JTAG接口的標準、工作原理及在芯片中的實現，根據JTAG接口所提供的邊界掃描" title="邊界掃描">邊界掃描功能，通過PC機并行接口" title="并行接口">并行接口模擬JTAG接口的時序，實現了使用目標系統中微處理器的JTAG接口對系統程序存儲器" title="程序存儲器">程序存儲器FLASH的編程。
關鍵詞: 嵌入式系統 ?JTAG(Joint Test Action Group)聯合測試行為組織? 編程器" title="編程器">編程器? StrongARM? 手持設備
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隨著手持式電子設備的迅猛發展，手機、PDA、掌上電腦、電子書和數碼相機等正在快步走進人們的日常生活。這一類電子產品同屬于嵌入式系統的范疇，都是以高性能的微處理器為核心擴展相應的存儲器和功能電路，運行小巧的操作系統和相應的應用程序，實現電子設備的各種功能。由于是手持設備，因而要求體積小、重量輕、耗電少。這些特點決定了設備內部的印制板的尺寸比常規電子設備小得多，而且元器件密度大，雙面貼裝。這給設計人員帶來了若干問題，如操作系統代碼和應用程序的寫入，板上芯片的測試等。本文作者結合實際工作，就嵌入式系統中如何通過JTAG接口進行FLASH芯片編程作了探討。
1 幾種常用的芯片編程方法
在嵌入式系統開發和產品生產過程中，對系統程序存儲器編程主要使用三種編程方法:通過編程器編程、使用板上編程器編程和在系統編程。
1.1 通過編程器編程
這是在PROM、EPROM、PAL等芯片流行時常用的傳統編程方法，即在可編程芯片焊裝到電路板之前，使用專門的編程器對芯片進行代碼或數據的寫入，然后將已編程的芯片安裝到電路板上。
使用編程器進行編程特別適合于DIP封裝的芯片，如果是其它類型的封裝，則必須使用相應的適配器。這種方法的缺點是需要手工進行待編程芯片的插入、鎖定等工作，容易造成芯片方向錯誤、引腳錯位等，導致編程效率降低。
1.2 使用板上編程器編程(OBP)
這種方法是在電路板上所有芯片已經焊裝完畢后，再對板上的可編程芯片進行編程。通過專用電纜將電路板與外部計算機連接，由計算機的應用程序進行板上可編程芯片的代碼或數據寫入。芯片擦除、編程所需要的電源、控制信號、地址、數據和相關命令都由板外的編程控制器提供。在進行板上編程時，需要通過專門的輔助電路關斷目標板上CPU的電源或將其外部接口信號設置為高阻狀態，以免與編程時的地址、數據和控制信號發生沖突。
在板上編程可以克服芯片引腳錯位、方向插反等問題，避免燒毀芯片、編程錯誤，保證了芯片編程的高成功率和可靠性。另一個優點就是及時軟件升級，可以做到在產品出廠時系統使用最新版本的固化軟件，這對于日新月異的手持電子設備而言是必須的。
這種方法的缺點是需要在電路板上設計編程用的接口、隔離等輔助電路，在編程時通過跳線或FET開關進行編程與正常工作的狀態轉換。這樣會增加每個電路板芯片的數量，造成產品成本的增加。
1.3 在系統編程(ISP、ISW)
這種方法直接利用系統中帶有JTAG接口的器件如CPU、CPLD、FPGA等，執行對系統程序存儲器芯片內容的擦除和編程操作。一般而言，高檔微處理器均帶有JTAG接口，系統程序存儲器的數據總線、地址總線和控制信號直接接在微處理器上。編程時，使用PC機內插卡或并行接口通過專用電纜將系統電路板與PC機聯系起來，在PC機上運行相關程序，將編程數據及控制信號傳送到JTAG接口的芯片，利用相應指令從微處理器的引腳按照FLASH芯片的編程時序輸出到FLASH存儲器。
這種編程方法的條件是系統中必須存在帶有JTAG接口或與之兼容的芯片如微處理器。優點是系統板上不需要增加其它與編程有關的輔助電路，減小了電路板的尺寸，避免了對微小封裝芯片的手工處理，特別適用于電路板尺寸有嚴格限制的手持設備。
2 JTAG接口介紹
面對復雜電路的設計、整板測試的難度及表面貼裝技術帶來的有限測試引腳等問題，業界不得不尋找一個標準加以解決。JTAG邊界掃描即IEEE1149.1標準，該測試標準定義了用于解決上述問題的硬件結構和工作機制。其優點在于將極其復雜的印刷電路板測試轉變成具有良好結構性、可以通過軟件簡單而靈活處理。它雖然是一個主要用于片上電路的測試標準，但卻打開了各種相關應用的大門。這個標準定義了可用于完成功能和互連測試以及內建自測過程的各種指令。芯片生產廠商如ALTERA、XILINX、ATMEL、AMD、TI等對標準進行了擴充，使用擴展的專用指令執行維護和診斷應用及對可配置器件的可編程算法，使JTAG接口廣泛用于FLASH系列芯片的編程。概括起來，JTAG接口主要應用于:電路的邊界掃描測試和可編程芯片的在系統編程。
2.1 JTAG接口的結構
在硬件結構上，JTAG接口包括兩部分:JTAG端口和控制器。與JTAG接口兼容的器件可以是微處理器(MPU)、微控制器(MCU)、PLD、CPL、FPGA、ASIC或其它符合IEEE 1149.1規范的芯片。IEEE 1149.1標準中規定對應于數字集成電路芯片的每個引腳都設有一個移位寄存單元，稱為邊界掃描單元BSC。它將JTAG電路與內核邏輯電路聯系起來，同時隔離內核邏輯電路和芯片引腳。由集成電路的所有邊界掃描單元構成邊界掃描寄存器BSR。邊界掃描寄存器電路僅在進行JTAG測試時有效，在集成電路正常工作時無效，不影響集成電路的功能。具有JTAG接口的芯片內部結構如圖1所示。
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測試邏輯的最高級電路包括3個主要模塊:
· 測試訪問端口(TAP)控制器
TAP控制器提供對嵌入在JTAG兼容器件內部的測試功能電路的訪問控制，是一個同步狀態機。每個JTAG兼容的器件都有自己的TAP控制器。通過測試模式選擇TMS和時鐘信號TCK控制其狀態轉移，實現由IEEE1149.1 標準確定的測試邏輯電路的工作時序?！?/P>
· 指令寄存器
指令寄存器是基于電路的移位寄存器，通過它可以串行輸入執行各種操作的指令。
· 數據寄存器組
數據寄存器組是一組基于電路的移位寄存器。操作指令被串行裝入由當前指令所選擇的數據寄存器。隨著操作的執行，測試結果被移出。
2.2 JTAG引腳定義
JTAG接口主要包括四個引腳:TMS、TCK、TDI和TDO及一個可選配的引腳TRST，用于驅動電路模塊和控制執行規定的操作。各引腳的功能如下:
·TCK:JTAG測試時鐘，為TAP控制器和寄存器提供測試參考。在TCK的同步作用下通過TDI和TDO引腳串行移入或移出數據及指令。同時，TCK為TAP控制器狀態機提供時鐘。
·TMS:TAP控制器的模式輸入信號。TCK的上升沿時刻TMS的狀態確定TAP控制器即將進入的工作狀態。通常TMS引腳具有內部上拉電阻，以保證該引腳在沒有驅動時處于邏輯1狀態。
·TDI:JTAG指令和數據寄存器的串行數據輸入端。TAP控制器的當前狀態以及保存在指令寄存器中的具體指令決定對于一個特定的操作由TDI裝入哪個寄存器。在TCK的上升沿時刻，TDI引腳狀態被采樣，結果送到JTAG寄存器組。
·TDO:JTAG指令和數據寄存器的串行數據輸出端。TAP控制器的當前狀態以及保持在指令寄存器中的具體指令決定對于一個特定的操作哪個寄存器的內容送到TDO輸出。對于任何已知的操作，在TDI和TDO之間只能有一個寄存器(指令或數據)處于有效連接狀態。TDO在TCK的下降沿改變狀態，并且只在數據通過器件移動過程中有效。該引腳在其它時間處于三態狀態。
·TRST:測試復位輸入信號，低電平有效，為TAP控制器提供異步初始化信號。
2.3 JTAG測試訪問端口(TAP)控制器
TAP控制器是一個16狀態的有限狀態機，為JTAG提供控制邏輯，控制進入到JTAG結構中各種寄存器內數據的掃描與操作。TAP狀態轉移圖如圖2所示，由TCK同步時鐘上升沿時刻TMS引腳的邏輯電平決定狀態轉移的過程(高電平TMS=1，低電平TMS=0)。對于由TDI端輸入到器件的掃描信號共有兩個狀態變化路徑:一個用于移入指令到指令寄存器;另一個用于移入數據到有效的數據寄存器，該寄存器由當前指令確定。
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狀態圖中的每個狀態都是通過TAP控制器進行數據處理所需要的。這些處理包括給引腳施加激勵信號，捕獲輸入的數據，裝載指令，邊界掃描寄存器中數據的移入或移出。圖2表示了TAP狀態機的基本流程，描述了從一個狀態到另一個狀態TMS信號的變化，在芯片JTAG接口的TRST引腳上加一低脈沖信號可以使TAP控制器復位到測試邏輯復位(Test-Logic-Reset)主狀態。
2.4 JTAG接口的控制指令
控制指令用于控制JTAG接口進行各種操作，控制指令包括基本指令和擴展指令。JTAG接口標準要求芯片支持的基本指令有:EXTEST、INTEST、SAMPLE/PRELOAD、BYPASS、IDCODE、HIGHZ。芯片廠商可以根據實際需要選擇或添加擴展指令。
3 JTAG接口的使用
通過JTAG接口可以進行電路板及芯片的測試，也可以實現對目標電路板上的程序存儲器編程。本文僅討論使用JTAG接口對板上FLASH存儲器的編程。一般，可以利用專用的PC機內插卡式硬件控制器或獨立的編程器訪問JTAG器件，也可以直接由PC機的并行接口模擬JTAG時序，硬件控制器或編程器通過專用電纜連接到目標電路板。被編程的FLASH存儲器芯片的地址線、數據線和控制信號線接到JTAG兼容芯片的相應引腳上。值得注意的是:采用這種編程方法，不要求FLASH器件具有JTAG接口，只要與其相連接的芯片具有JTAG接口即可。在編程FLASH芯片時，需要做的工作主要有:①PC機發送指令或數據到JTAG兼容芯片的邊界掃描寄存器(BSR);②將保存在BSR中的指令或數據通過JTAG專用指令傳送給FLASH存儲器。這個過程是由運行在PC機上的軟件進行控制的。
3.1 硬件配置
在某個設計項目中，使用了Intel公司的 StrongARM芯片SA-1110和該公司的Strata系列FLASH存儲器芯片。SA-1110芯片是一種高性能、低功耗、集成有多種常用接口的SOC微處理器芯片，特別適合于手持設備。而Strata FLASH是Intel公司使用獨創的1個存儲單元記錄2比特數據技術制造的閃速存儲器芯片，其特點是體積小、容量大、成本低，特別適合于程序代碼與數據的存儲。選擇的型號為:E28F128J3A，可以配置成8位或16位數據線方式。SA-1110為32位芯片，其外擴的程序存儲器和數據存儲器也為32位，因此程序存儲器需要2片28F128J3A配置為32位形式，如圖3所示。
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在本例中，JTAG菊花鏈中包含兩個IEEE1149.1兼容芯片，即SA-1110微處理器和CPLD。由于FLASH的地址總線、數據總線和控制信號線接在SA-1110上，在利用JTAG接口編程FLASH存儲器時，與JTAG鏈上的CPLD芯片無關，需要通過指令將CPLD芯片設為旁通模式。FLASH芯片的控制信號如讀信號(/OE)、寫信號(/WR)和片選信號(/CE)等直接由SA-1110產生。
從圖3中可以看出，使用PC機并行接口的幾個數據線和信號線來構成JTAG接口引腳信號，對應關系如表1所示。采用信號線直接連接的方法簡便易行，只需要一條專用電纜即可操作JTAG接口。
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3.2 控制軟件
SA-1110芯片的JTAG接口實現了IEEE1149.1標準的部分功能，不能實現對芯片內部的測試及芯片仿真，但提供對芯片外的測試功能，可以用于對芯片外部電路的測試或編程。芯片提供的JTAG指令包括:
·BYPASS(11111) 旁通片上系統邏輯指令，用于未被測試的芯片;
·EXTEST(00000) 片外電路測試指令，用于測試電路板上芯片之間的互連;
·SAMPLE/PRELOAD(00001) 采樣引腳/預加載數據指令，用于采樣芯片引腳信號或通過加載數據控制引腳輸出信號;
·IDCODE(00110) 讀芯片識別碼指令，用于識別電路板上的芯片;
·HIGHZ(00101) 設置高阻態指令，用于將芯片的引腳設為無效狀態。
括號中的內容是指令的操作碼" title="操作碼">操作碼，它們通過TDI引腳串行移入到指令寄存器。BYPASS和EXTEST指令的操作碼是IEEE1149.1中規定的，因此對于所有的JTAG接口兼容芯片，這兩個指令的操作碼都是相同的。其它指令的操作碼可以由芯片廠商根據實際定義。
結合待編程的FLASH存儲器特征，利用上面提供的JTAG指令編寫一個編程FLASH存儲器的PC機應用程序，借助SA-1110芯片的JTAG接口將目標系統使用的操作系統和應用軟件寫入到FLASH存儲器中。對目標板上的FLASH存儲器進行編程時，在PC機上運行該程序來控制并行接口模擬JTAG時序并將編程代碼傳送到SA-1110的JTAG控制器，利用JTAG的邊界掃描單元(BSC)，把編程數據先移入到邊界掃描寄存器(BSR)。然后通過JTAG指令EXTEST按照FLASH芯片的編程時序將數據通過地址總線和數據總線寫入FLASH存儲器，實現芯片編程操作。在FLASH內容的寫入過程中，程序對2片FLASH同時執行寫操作，完成32位編程。在PC機上運行的編程操作程序框圖如圖4所示，其中利用PC機并行接口實現JTAG接口信號的函數為:
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int putp(int tdi， int tms， int rp)
{ ??? //Output pins (LPT driving)，LPT D0 Pin 2 and TCK，
???? ?? //LPT D1 Pin 3 and TDI，LPT D2 Pin 4 and TMS
???????? ?//Input pin (SA-1110 board drives)，LPT Busy Pin?11 and TDO
?????? ??? int tdo = -1；
?????? ??? _outp(lpt_address， tms*4+tdi*2)；?????? ??? //TCK low
?????? ??? _outp(lpt_address， tms*4+tdi*2+1)；?? //TCK high
?????? ??? if(rp=RP)_outp(lpt_address，tms*4+tdi*2)； //TCK low
?????? ??? if(rp=RP)tdo!((int)_inp(lpt_address+1)>>7)； //get TDO data
?????? ??? return tdo；
}
通過PC機并行接口實現SA-1110的JTAG指令EXTEST的函數為:
void extest(void)
{??????????? putp(1，0，IP)；? //Run-Test/Idle
???? ???????? putp(1，0，IP)；? //Run-Test/Idle
?????????? ????? putp(1，0，IP)；? //Run-Test/Idle
????????????? ?? putp(1，0，IP)；? //Run-Test/Idle
???????????????? putp(1，1，IP)； //select DR scan
???????????????? putp(1，1，IP)；? //select IR scan
???????????????? putp(1，0，IP)；? //capture IR
???????????????? putp(1，0，IP)；? //shift IR
???????????????? putp(0，0，IP)；? //SA1110 Extest，指令長度為5位
???????????????? putp(0，0，IP)；
???????????????? putp(0，0，IP)；
???????????????? putp(0，0，IP)；
???????????????? putp(0，0，IP)；
???????????????? putp(1，0，IP)；? //CPLD Bypass，指令長度為4位
???????????????? putp(1，0，IP)；
???????????????? putp(1，0，IP)；
???????????????? putp(1，1，IP)；? //Exit1-IR，操作碼的最后一位必須通過時鐘與下一狀態EXIT1_IR
???????????????????????????????????? 有效處于同一時刻，由時鐘控制TMS保持高電平時進入EXIT1_IR
?????????????????????????????????? ? 狀態。
???????????????? putp(1，1，IP)；? //Update-IR
?????? ????????? putp(1，0，IP)；? //Run-Test/Idle
????????? ?????? putp(1，0，IP)；? //Run-Test/Idle
???????????? ??? putp(1，0，IP)；? //Run-Test/Idle
}
程序開始有四條語句:putp(1，0，IP)。其意義在于無論JTAG狀態機處于何種狀態，經過這四條指令后，必將返回到Run-Test/Idle狀態，保證下面的操作從這一狀態開始進入正常的操作狀態。
編程FLASH存儲器使用的其它指令的實現方法與此類似。實踐表明，使用PC機并行接口實現JTAG時序的方法是可行的，對FLASH存儲器進行編程無需其它板卡設備支持，是一種較為簡單的方法。
使用JTAG接口對FLASH程序存儲器進行編程的方法適合于系統中帶有兼容JTAG接口的芯片。隨著具有JTAG接口芯片應用的普及，需要對JTAG接口有深入的了解，以便更好地利用芯片的資源，設計出容易測試、便于維護與升級的高可靠性系統，延長產品的生命周期。同時，根據FALSH芯片及JTAG接口芯片的規范對使用JTAG接口進行編程的控制程序的優化，可以實現存儲芯片的高速編程操作，對減少產品的研發和生產周期，保證產品的上市時間非常有利。
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參考文獻
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