誘發電位是指對神經系統某一特定部位給予特定刺激后在大腦皮層所產生的特定電活動，對于神經系統功能性異常的疾病有獨特的檢測診斷能力，也是大腦認知和腦機接口研究常用的技術手段。誘發電位儀通常包括視覺誘發電位、聽覺誘發電位和體感誘發電位三種檢測功能，其硬件系統核心組成部分包括：刺激信號源、腦電信號放大和數據采集。刺激信號源包括視覺刺激信號(如棋盤格、黑白閃光等)、聽覺刺激信號和神經刺激信號，一般采用分離設計。
腦電信號數據采集一般包括模／數轉換、數據預處理和數據傳輸等部分，而模／數轉換芯片和主控微處理器芯片的選擇主導了整個數據采集系統的性能。在目前的采集系統中，基于單片機的中低端控制芯片功能較弱，逐漸被DSP和ARM或增強型單片機所取代。DSP芯片采用哈佛結構的流水線工作方式，能實現復雜信號處理算法，如文獻采用DSP實現復雜的腦電信號采集系統；而ARM適合做事務處理或者中低端應用，如文獻中通過ARM處理器建立操作系統實現任務調度。盡管采用DSP和ARM芯片可使系統的運算能力和管理事務的能力得到很大增強，但是構成完整的數據采集系統通常還需要外部邏輯控制器件，尤其不能將數據采集和刺激信號源在單片上集成實現。
由于現代電子技術的飛速發展，可編程邏輯芯片FPGA的集成度越來越高，受到很多廠家和研究機構的關注，利用它的可編程性和可擴展，可將絕大部分的功能集成到FPGA芯片中。如文獻采用FPGA實現了腦電信號采集；文獻則將盲分離算法ICA在FPGA上實現，能同時對腦電信號進行采集和獨立分量分解。
本文針對誘發電位儀的硬件系統設計，提出將信號采集控制、處理、傳輸、刺激信號產生等功能集成在一塊FPGA芯片上的設計方案，并結合ADSl258模／數轉換芯片，使得系統具有16通道，每個通道24位采樣精度和400 kHz采樣率的高性能，而且電路結構簡單。
1 系統總體設計
本文提出的誘發電位儀包括了刺激信號源、數據采集和數據傳輸三大部分。其中核心控制芯片采用Altera公司的FPGA，產生刺激誘發信號源包括聽覺刺激、神經傳導刺激和視覺誘發刺激，以及實現對外圍電路如A／D，USB等模塊的控制并在芯片內部集成濾波算法模塊；數據采集采用高精度多通道的模／數轉換芯片ADSl258將通過放大器放大后的誘發電位信號進行模／數轉換并輸入FPGA內進行前置處理；數據傳輸通
過USB控制器Cypress 68013A將誘發電位數據傳輸至PC上位機，由上位機應用程序實現誘發腦電信號的后期處理、顯示、存儲等功能。系統總體框圖見圖1。
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2 FPGA軟件模塊設計
2．1 FPGA的優勢
FPGA即現場可編程門陣列，是在CPLD的基礎上發展起來的新型高性能可編程邏輯器件，它既繼承了ASIC的大規模、高集成度、高可靠性的優點，又克服了普通ASIC設計周期長、投資大、靈活性差的缺點，逐步成為復雜數字硬件電路設計的理想選擇。不同于傳統的誘發電位儀設計，本文將大部分分立元件實現的功能集成到了FPGA芯片中，實現多種刺激模式和濾波模塊以及實現對外圍器件的控制，不僅提高了集成度使儀器小型化、便攜化成為可能，而且片內模塊可反復修改，提高了設計開發效率降低了成本，也可以方便地實現各模塊之間的同步。
2．2 軟件模塊整體設計
本設計中，FPGA芯片軟件模塊包括了誘發電位刺激模塊、信號傳輸控制模塊和數字信號處理模塊三大部分；由共同的同步信號協同合作，完成誘發電位儀的誘發刺激、信號的傳輸、數字濾波等核心控制處理功能。FPGA內軟件模塊框圖如圖2所示。
2．3 誘發電位刺激模塊
在FPGA芯片中設計了誘發電位刺激模塊，主要功能包括：聽覺誘發電位刺激、神經傳導刺激和視覺誘發電位刺激。刺激信號主要由脈沖信號進行控制，通過 FPGA芯片可以直接輸出脈沖信號和VGA控制信號。聽覺誘發刺激信號和神經傳導刺激信號可由FPGA輸出的脈沖信號經功率放大后產生，在此聽覺誘發電位刺激信號為雙通道，一路信號產生脈沖信號如PWM(脈寬調制)波，另一路由FPGA芯片內部模塊通過DA轉換器產生白噪聲，而神經傳導刺激信號可直接由 FPGA輸出PWM脈沖直接驅動電壓放大器生成。通過Verilog硬件描述語言，在FPGA中實現誘發電位刺激源信號，并通過FPGA端口輸出，例如在芯片中使用以下代碼可產生一個占空比為PWM_WIDTH：1的PWM波形：
視覺誘發刺激信號由在FPGA芯片中存儲的刺激圖像數據直接產生VGA時序控制信號，控制VGA顯示器顯示棋盤格或彩條刺激圖像給予人體視覺刺激。
誘發電位刺激信號主要參數包括刺激脈寬、刺激頻率、刺激強度、刺激類型和刺激模式，USB芯片從上位機接收到參數配置信號，傳遞給誘發刺激信號生成模塊發出脈沖。例如，生成聽覺誘發電位刺激信號如圖3所示，它的刺激脈寬為O．2 ms，刺激頻率為12 Hz，設置某一刺激強度(由分貝進行度量)；而生成視覺誘發電位刺激信號，刺激頻率為2 Hz，刺激類型為棋盤格模式，刺激模式為16×16。
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2．4 信號傳輸控制模塊
在FPGA內部將完成誘發電位儀同步信號發生模塊、A／D轉換器的控制、USB傳輸控制端口和上位機命令解析模塊，從而形成一整個誘發電位儀核心處理控制模塊，可以方便地使用各個模塊來完成外圍器件的初始化、工作模式配置和系統的數據傳輸。圖4為信號傳輸控制流程圖。
2．5 數字信號處理模塊
數字信號處理模塊集成到FPGA中，可以將算法拆分，形成大規模的數字信號處理并行結構，將極大地提高處理速度，且性能不會下降，如模式識別算法、盲源分離算法等，均比較適合集成到FPGA中實現。在前置模擬電路放大之前，腦電信號為微弱混雜的信號，需要做一些濾波處理，而此處可以將前段部分的帶通濾波電路轉化為數字濾波器，設置到FPGA芯片中去，可簡化電路結構，使系統整體體積大大減小。本設計在FPGA芯片中搭建了四階無限脈沖數字濾波器，其系統傳遞函數H(z)如下：
將誘發電位信號放大模／數轉換之后的數據實時經過濾波，實現信號的前置處理，經測試效果良好。利用FPGA的并行性，在每個通道設置一個數字濾波器，大大增強了系統實時性，而且可探索自適應、小波數字濾波器等設計，在硬件層次提高系統的處理能力。
3 高精度多通道模／數轉換器ADSl258
在誘發電位儀采集系統中，模／數轉換模塊芯片的選取對整個采集系統的結構和性能影響非常大，本文模／數轉換芯片選用ADSl258器件，使得本系統達到多通道高分辨率的要求。
3．1 ADSl258的主要特點
ADSl258是16通道24位分辨率的低噪聲模／數轉換芯片，全量程5 V的單端輸入范圍或者±2．5 V的真雙極輸入，每個通道采樣速率最高23．7 KSPS(16通道同時采樣)，單個通道采樣最高可達400 KSPS，通過SPI兼容接口進行工作模式配置和串行數字通信，使用方便。選用此芯片，電壓分辨率即可達到1 μV，因此信號放大和調理預處理電路的放大倍數只要100倍就可滿足誘發電位儀的技術要求，大大簡化了前級電路。
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3．2 ADSl258與FPGA接口電路
ADSl258通過一個SPI兼容串行接口將數據寫入配置寄存器，使用命令控制轉換器以此來控制A／D芯片的工作模式，并最終讀取通道數據。接口包含，SCLK，DIN 和DOUT四個信號。對ADSl258的所有操作都得先向其寫入命令，然后由AD根據寫入的命令做相應的操作。經過FPGA的A／D配置模塊啟動之后，ADSl258將處于固定通道掃描模式下或者自動通道掃描模式下，ADSl258將可轉換16路共模輸入信號或8路差分輸入信號。模擬信號由AIN口輸入，輸入范圍0～+5 V。外圍控制端口接駁到FPGA，由FPGA控制模塊控制A／D采樣，由進行選通，START啟動ADC開始工作，通過DIN輸入命令之后由DOUT輸出轉換結果，共使用8個端口與FPGA芯片的端口相連接。具體接口電路的實現如圖5所示。
4 結語
利用FPGA芯片豐富的資源，將誘發電位儀的刺激信號源、模／數轉換控制邏輯和USB接口控制與數據傳輸以及數字信號處理等模塊設計在單個芯片上，可最大限度地簡化誘發電位儀的硬件電路復雜度，利用其可編程性極大地方便了硬件設計，結合ADSl258的高分辨率的優勢，可以使系統既具有優異的性能又具有很高的集成度，而且本設計尚余很多FPGA的I／O口，如需更多通道則僅需要加入多塊A／D芯片，具有較高的應用價值。