Mentor Graphics 公司（納斯達克代碼：MENT）今天宣布，Mellanox Technologies 已將全新的Mentor? Tessent ?階層化 ATPG 解決方案標準化，以管理復雜度及削減其先進的集成電路 (IC) 設計生成測試向量所需的成本。高品質的 IC 測試需要大量的制造測試向量，Mellanox 運用 Tessent 階層化 ATPG，顯著減少了生成這些測試向量所需的處理時間和系統內存。
　　Logo - http://photos.prnewswire.com/prnh/20140317/AQ83812LOGO
　　“每一個新設計周期生成測試向量所需的時間迅速增長，這也就增加了我們相關的測試成本，”Mellanox Technologies 后端工程副總裁 Evelyn Landman 說道?！斑x用 Mentor Graphics的 Tessent 階層化 ATPG 流程可使我們大大減少當前設計的運行時間。由于此解決方案的可擴展性較高，我們計劃在未來的設計中繼續使用該方案?！?br/>　　Tessent 階層化 ATPG 流程采用分治法，即將整個 ATPG 任務分解為更小的模塊，更加便于管理。每一個設計內核首先會單獨生成壓縮測試向量，然后再自動重定向到芯片級并合并，從而盡可能縮短測試時間。此時，將會生成用于頂層互連邏輯的壓縮測試向量。此技術可使需要大量運算的DFT 步驟免于成為流片過程中的瓶頸，并且加強測試流程的可預測性。
　　相比在所有模塊和頂層互連邏輯在芯片級運行 ATPG，階層化 ATPG 方案可顯著減少運行時間和內存占用。一般而言，運行時間可縮減 5-10 倍，而內存占用節省比例甚至更高。由于所有內核使用掃描通道方式的效率得到提升，階層化 ATPG 通?？墒箿y試向量數量減少 2 倍，測試時間也相應得以減少。
　　“我們很多客戶都在使用階層化設計法管理設計規模和復雜度。大多數客戶都已清楚他們的測試生成流程必須與此階層化方案相契合，“負責 Mentor Graphics的 Tessent DFT 和 ATPG 產品的產品營銷總監 Stephen Pateras 說道?！拔覀內碌碾A層化 ATPG 解決方案不僅可擴展 100M 以上的門級設計，而且可使 DFT 和 ATPG 能更容易地分配于不同的設計小組并在設計周期中更早運行，從而加速進度?！?br/>　　About Mentor Graphics
　　Mentor Graphics公司是電子硬件和軟件設計解決方案(EDA)的全球領導者，為世界上最成功的通信、半導體，計算機，消費電子，汽車電子和國防軍工公司提供優質產品、咨詢服務和支持, 可加快客戶電子及機械產品的研發速度，提高產品質量，增加成本效益。工程師可借助公司不斷推出的新產品及解決方案，應對日趨復雜的電路板及芯片設計領域面臨的挑戰。Mentor Graphics公司擁有業內最為豐富的頂級產品線，提供完整的SOC/IC/FPGA/PCB/SI設計工具和服務，并且是唯一一家擁有嵌入式軟件解決方案的EDA公司。公司成立于1981年，目前有超過70家分公司分布世界各地。
　　公司總部地址：8005 S.W. Boeckman Road, Wilsonville, Oregon 97070-7777。
　　上市公司（納斯達克代碼：MENT)
　　成立于1981年，總部位于俄勒岡州威爾遜維爾市
　　全球設有70多個分公司或辦事處
　　已在中國上海、北京、深圳設立分支機構
　　公司網址 - www.mentor.com www.mentorg.com.cn